12 cœurs par CCD, 144 Mo de 3D V-Cache et +27 % d’IPC : ce que l’architecture Zen 6 d’AMD prépare pour les futurs Ryzen gaming
Lorsque les ingénieurs d’AMD dévoilent les entrailles de leurs puces pour centres de données, ils livrent en réalité les plans exacts des processeurs qui équiperont nos tours de jeu quelques mois plus tard. En marge de la présentation de ses plateformes serveurs EPYC 9006 « Venice » et EPYC 9006 LP « Verano » pensées pour réduire de moitié la consommation de barrettes DDR5, la firme de Santa Clara a détaillé les spécifications microarchitecturales complètes de ses nouveaux cœurs haute performance Zen 6. Entre le passage historique à 12 cœurs par chiplet (CCD) en gravure 2 nm, une déclinaison 3D V-Cache grimpant à 144 Mo de cache L3 par CCD et un bond d’IPC moyen de 27 %, ce briefing technique dessine un saut générationnel majeur pour les futurs processeurs de bureau AMD Ryzen (« Olympic Ridge ») attendus sur le socket AM5.
La fin du plafond des 8 cœurs : 12 cœurs Zen 6 et 48 Mo de cache L3 sur un seul CCD en 2 nm
Depuis l’avènement de Zen 3 en 2020 jusqu’aux récents Ryzen 9000 basés sur Zen 5, les chiplets de calcul haute performance d’AMD (les Core Complex Dies, ou CCD) sont restés figés sur une topologie maximale de 8 cœurs physiques partageant un bloc de 32 Mo de mémoire cache L3. Avec l’architecture Zen 6, dont les dés de calcul sont gravés sur le nœud de finesse TSMC N2P (classe 2 nm), le constructeur brise enfin cette barrière physique en logeant 12 cœurs haute performance sur un seul et unique CCD (à distinguer des chiplets denses Zen 6c réservés au cloud, qui montent à 32 cœurs plus compacts par CCD).
Comme les architectes d’AMD maintiennent leur règle d’or allouant 4 Mo de cache L3 natif par cœur, la mémoire tampon partagée à l’intérieur d’un unique CCD grimpe mécaniquement de 32 Mo à 48 Mo (+50 %). Pour les joueurs PC, ce changement structurel résout l’un des plus vieux compromis de la gamme Ryzen.
Sur nos machines actuelles, un processeur de 12 cœurs (comme un Ryzen 9 7900X ou 9900X) doit obligatoirement répartir ses unités de calcul sur deux chiplets distincts de 6 cœurs chacun. Dès qu’un moteur graphique sollicite plus de 6 cœurs ou échange des données d’un chiplet à l’autre via l’interconnexion Infinity Fabric, une pénalité de latence inter-CCD vient freiner le débit d’images. Avec Zen 6, un futur Ryzen à 12 cœurs et 24 threads tiendra intégralement sur un seul dé de silicium : les 12 cœurs puiseront directement dans le même réservoir local de 48 Mo de cache L3 sans la moindre latence de traversée, tandis que les modèles vitrines à deux chiplets pourront s’envoler jusqu’à 24 cœurs et 48 threads. D’autant qu’AMD a déjà confirmé la longévité du socket AM5 au-delà de 2029, assurant aux possesseurs de cartes mères actuelles une voie de mise à niveau directe.
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Venice-X et 3D V-Cache de nouvelle génération : vers des puces gaming dotées de 144 Mo de cache L3 par CCD
La seconde révélation majeure se niche dans la fiche technique de la gamme EPYC « Venice-X » (série 9006X), taillée pour les simulations physiques lourdes et l’ingénierie assistée par ordinateur. Ces processeurs associent 8 chiplets Zen 6 standards de 12 cœurs (soit 96 cœurs au total) à une nouvelle génération de mémoire empilée verticalement 3D V-Cache, assemblée par liaison hybride directe (3D Hybrid Bonding). L’ensemble atteint une capacité totale vertigineuse de 1 152 Mo (1,15 Go) de cache L3 par socket, tout en maintenant une fréquence Boost culminant à 5,30 GHz.
L’arithmétique appliquée aux futurs processeurs gaming Ryzen X3D est immédiate : en divisant ces 1 152 Mo par les 8 chiplets présents sur le socket, chaque CCD de 12 cœurs embarque exactement 144 Mo de mémoire cache L3. Sachant que le CCD natif intègre déjà 48 Mo de cache L3 sur sa base en 2 nm, la tranche additionnelle de 3D V-Cache empilée passe de 64 Mo (sur Zen 4 et Zen 5) à 96 Mo par CCD (+50 %). Transposé sur le segment grand public, le successeur direct de l’actuel Ryzen 7 9800X3D pourra ainsi aligner 12 cœurs unifiés épaulés par 144 Mo de cache L3 sur un seul CCD, contre 8 cœurs et 96 Mo aujourd’hui, éliminant au passage les casse-tête d’ordonnancement sous Windows 11.
Processeur AMD Ryzen 7 9800X3D (Socket AM5, 96 Mo 3D V-Cache)
- 8 cœurs / 16 threads Zen 5 avec 96 Mo de cache L3 3D V-Cache de 2e génération
- Fréquence Boost jusqu'à 5,2 GHz et débloqué pour l'overclocking
- Plateforme Socket AM5 prête à accueillir les futurs Ryzen Zen 6
Registres à 352 entrées, ROB à 640 entrées et +27 % d'IPC : comment AMD débride son moteur d'exécution
Sur la génération actuelle Zen 5, plusieurs bilans techniques avaient pointé un paradoxe en jeu : si AMD avait considérablement élargi le décodeur d'instructions en amont (front-end), les canaux internes manquaient parfois de débit pour alimenter simultanément toutes les unités de calcul. Avec Zen 6, les architectes ont massivement redimensionné la tuyauterie interne du processeur afin d'éliminer tout goulot d'étranglement :
| Caractéristique architecturale | AMD Zen 5 (Ryzen 9000) | AMD Zen 6 (Venice / Futurs Ryzen) | Évolution brute |
|---|---|---|---|
| Finesse de gravure du CCD | TSMC N4P (classe 4 nm) | TSMC N2P (classe 2 nm) | Saut de nœud complet |
| Cœurs par CCD haute performance | 8 cœurs / 16 threads | 12 cœurs / 24 threads | +50 % de cœurs par dé |
| Cache L3 natif par CCD | 32 Mo (4 Mo par cœur) | 48 Mo (4 Mo par cœur) | +50 % de cache natif |
| Cache 3D V-Cache par CCD (X3D) | +64 Mo (96 Mo L3 au total) | +96 Mo (144 Mo L3 au total) | +50 % de cache empilé |
| Registres physiques entiers (PRF) | 240 entrées | 352 entrées | +46,7 % |
| Tampon de réorganisation (ROB) | 448 entrées | 640 entrées | +42,8 % |
| Cache d'opérations (Op-Cache) | Liaison interne 12 bits | 6,75 K entrées / Liaison 18 bits | +50 % de bande passante |
| Unité vectorielle et IA (FPU) | 2 pipelines VNNI INT8 | 4 pipelines VNNI INT8 + AVX-512 FP16 natif | Débit doublé en INT8 |
L'élargissement du banc de registres physiques entiers (Integer PRF) de 240 à 352 entrées et du tampon de réorganisation (Reorder Buffer) de 448 à 640 entrées permet au cœur Zen 6 de suivre un volume beaucoup plus massif d'instructions en vol sans jamais subir de famine de données. En parallèle, le cache d'opérations (Op-Cache) grimpe à 6,75 K entrées et voit sa liaison interne passer de 12 à 18 bits de large, offrant un bond immédiat de 50 % de bande passante vers les unités d'exécution. Combinées aux nouvelles files d'attente Load/Store et au traitement matériel natif des instructions AVX-512 FP16, ces optimisations délivrent un gain d'IPC moyen de 27 % à fréquence égale face à Zen 5.
Mon avis sur cette fiche technique
En analysant les schémas internes de Zen 6, je vois surtout la correction exacte de tout ce qui bridait encore Zen 5 dans les moteurs de jeu modernes. Sur les Ryzen 9000 actuels, le front-end élargi avait parfois l'allure d'une autoroute à six voies débouchant sur un tunnel à deux voies faute de registres et de bande passante d'Op-Cache suffisants. En poussant le banc de registres entiers à 352 entrées, le ROB à 640 entrées et le bus d'Op-Cache à 18 bits, AMD fait sauter ce verrou interne.
Mais la vraie révolution pour nos configurations gaming sur socket AM5, c'est évidemment ce chiplet CCD unifié de 12 cœurs en 2 nm capable d'embarquer 144 Mo de cache L3 en version 3D V-Cache. Pouvoir profiter de 12 cœurs ultra rapides partageant le même bloc de 144 Mo sans jamais traverser l'Infinity Fabric ni dépendre du gestionnaire de tâches de Windows pour parquer un second chiplet va redéfinir la stabilité du frametime (1 % Low) en 2027. Nous n'avons évidemment pas encore pu éprouver cette nouvelle génération de silicium au laboratoire : dès que les premiers échantillons de bureau seront prêts, notre banc d'essai sera grand ouvert à AMD pour vérifier ces gains face au 9800X3D.
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Passionné de hardware et de jeu vidéo, Arthur « Heimdall » navigue entre la France et l'Angleterre où il travaille dans la vente de solutions logicielles B2B. Diplômé d'école de commerce et passionné de bancs d'essai, il monte et démonte des PC depuis son enfance, traquant chaque degré thermique et chaque milliseconde de latence d'affichage. Joueur éclectique passé par Assassin's Creed et Roblox, c'est sur les raids de World of Warcraft qu'il a rencontré Grimtag et Chaya avant de rejoindre l'aventure Pro-Gamer.
